職責(zé)描述：
1、負(fù)責(zé)無(wú)線基站硬件開(kāi)發(fā)項(xiàng)目FPGA邏輯coding和debug；
2、負(fù)責(zé)相關(guān)文檔的需求、架構(gòu)、設(shè)計(jì)規(guī)范和驗(yàn)證；
3、協(xié)助系統(tǒng)聯(lián)調(diào)，編寫相關(guān)設(shè)計(jì)文檔。

任職要求：
1、本科以上學(xué)歷，2年數(shù)字中頻設(shè)計(jì)工作經(jīng)驗(yàn)，精通verilog或熟悉VHDL；
2、熟悉FPGA的接口函數(shù)和邏輯，高速SerDes，并行總線接口，串行總線接口；
3、熟悉數(shù)字中頻設(shè)計(jì)，熟悉高速ADC、DAC等外部設(shè)備。模擬電路，熟悉無(wú)線電結(jié)構(gòu)和設(shè)計(jì)方法。

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